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言語https://ja.cppreference.com/c/language/atomic
1 定数https://ja.cppreference.com/c/atomic/memory_order#定数
1.1 緩和された順序付けhttps://ja.cppreference.com/c/atomic/memory_order#緩和された順序付け
1.2 解放-消費順序付けhttps://ja.cppreference.com/c/atomic/memory_order#解放-消費順序付け
1.3 解放シーケンスhttps://ja.cppreference.com/c/atomic/memory_order#解放シーケンス
1.4 解放-取得順序付けhttps://ja.cppreference.com/c/atomic/memory_order#解放-取得順序付け
1.5 逐次一貫性順序付けhttps://ja.cppreference.com/c/atomic/memory_order#逐次一貫性順序付け
2 volatile との関係https://ja.cppreference.com/c/atomic/memory_order#volatile_との関係
3 例https://ja.cppreference.com/c/atomic/memory_order#例
4 参考文献https://ja.cppreference.com/c/atomic/memory_order#参考文献
5 関連項目https://ja.cppreference.com/c/atomic/memory_order#関連項目
6 外部リンクhttps://ja.cppreference.com/c/atomic/memory_order#外部リンク
緩和された順序付けhttps://ja.cppreference.com/c/atomic/memory_order#Relaxed_ordering
解放-消費順序付けhttps://ja.cppreference.com/c/atomic/memory_order#Release-Consume_ordering
消費-取得順序付けhttps://ja.cppreference.com/c/atomic/memory_order#Release-Acquire_ordering
解放-取得順序付けhttps://ja.cppreference.com/c/atomic/memory_order#Release-Acquire_ordering
解放-消費順序付けhttps://ja.cppreference.com/c/atomic/memory_order#Release-Consume_ordering
逐次一貫性順序付けhttps://ja.cppreference.com/c/atomic/memory_order#Sequentially-consistent_ordering
c/language/atomichttps://ja.cppreference.com/c/language/atomic
rcu_dereferencehttps://ja.wikipedia.org/wiki/%E3%83%AA%E3%83%BC%E3%83%89%E3%83%BB%E3%82%B3%E3%83%94%E3%83%BC%E3%83%BB%E3%82%A2%E3%83%83%E3%83%97%E3%83%87%E3%83%BC%E3%83%88
ミューテックスhttps://ja.cppreference.com/c/thread#Mutual_exclusion
アトミックなスピンロックhttps://ja.cppreference.com/c/atomic/atomic_flag_test_and_set
volatile lvaluehttps://ja.cppreference.com/c/language/volatile
データ競合https://ja.cppreference.com/c/language/memory_model
MSDNhttp://msdn.microsoft.com/en-us/library/12a04hfd(v=vs.100).aspx
C++リファレンスhttps://ja.cppreference.com/cpp/atomic/memory_order
MOESI protocolhttps://en.wikipedia.org/wiki/MOESI_protocol
x86-TSO: A Rigorous and Usable Programmer’s Model for x86 Multiprocessorshttp://www.cl.cam.ac.uk/~pes20/weakmemory/cacm.pdf
A Tutorial Introduction to the ARM and POWER Relaxed Memory Modelshttp://www.cl.cam.ac.uk/~pes20/ppc-supplemental/test7.pdf
MESIF: A Two-Hop Cache Coherency Protocol for Point-to-Point Interconnectshttps://researchspace.auckland.ac.nz/bitstream/handle/2292/11594/MESIF-2009.pdf?sequence=6
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